无线电电子与电气工程百科全书 数字变频器。 无线电电子电气工程百科全书 具有稳定重复率的脉冲通常由晶体振荡器信号使用分频器形成,该分频器将其频率降低所需的(主要是整数)次数。 但是,由于缺少所需的石英谐振器,导致初始频率与所需频率之比不是整数的情况下,经常需要使用具有分数转换因子的分频器[1, 2]。 诚然,它们形成的振荡周期不是恒定的,但在某些设备中这并不重要。 为读者提供了这种设备的另一个版本,其工作原理如下。 如果我们将发生器信号 f 的频率表示为所需值 f 的总和0 和绝对误差df,即可得到频率f0 执行减法运算就足够了:f0=f-df。 实际上,归结为从脉冲序列中消除每个脉冲的重复率f,其数量n=f/df,向上舍入到最接近的整数。 例如,如果 f=10147 kHz,则 af0\u10000d 147 kHz,然后 df \u10147d 147 Hz 和 n \u69,27d 69 / 69 \uXNUMXd XNUMX,即 XNUMX。因此,从原始序列中排除每 XNUMX 个脉冲,我们得到 f0=ff/69=10147-10147/69=9999,943 kHz。 在这种情况下,由于消除的脉冲数四舍五入而产生的相对误差为-5,7 * 10-6 通过调节发电机即可轻松消除。 实现该方法的变频器框图如图 1 所示。 1、计数器D2、解码器D2和复位锁定脉冲发生器G1组成一个转换因子为n的分频器。 当来自石英振荡器 G2 的编号为 n 的脉冲到达时,解码器 D2 的输出端出现一个信号,该信号打开振荡器 G3。 它产生的单个脉冲到达 D1 键的输入之一,将其阻塞,同时将计数器 D1 设置为零。 延迟线DT1将晶体振荡器G3的脉冲延迟等于或略大于分频器节点的操作延迟的时间。 这确保了在开关 D2 的输入端同时接收信号,并且如果发生器 GXNUMX 的脉冲持续时间足够长,则将编号为 n 的脉冲从序列中排除。 之后,转换器的新的运行周期开始。
图 10143,57 显示了重复频率 f = 68 kHz、n = 2 时石英振荡器脉冲转换器的示意图。 1.1. 根据[3]中描述的方案在元件DD1.2 上制作晶振。 元素 DD2 - 缓冲区。 计数器由微电路DD3、DD4构成,解码器由元件DD1.4构成。 晶体振荡器的脉冲传递到按键 DD2 的延迟由 R2C2 电路提供。 图中所示额定值的延迟时间 (t=R2С16) 大约等于 1.3 ns。 没有明确的复位和阻塞脉冲发生器。 其功能由适当连接的元件DD2和微电路DD4-DDXNUMX执行。
转换器的操作由图 3 所示的时序图解释。 2. 当第 4 个发生器脉冲到达计数器 DD68 和解码器 DD3 的输入端时(图 1,a),解码器的所有输入端均设置为 3 级(图 XNUMX,c-e),并延迟开启时间(th.DD4)级别 0 出现在其输出处(图 3,e),影响 DD1.4 键的输入之一。 由于时间t的延迟,约等于th.DD4,钥匙的另一个输入同时接收发生器的第 68 个脉冲(图 3,b),但是,它不会传递到设备的输出,因为钥匙已关闭(图 3,h)。 经过延迟时间t后h.DD1.3并且元件DD1.3被切换并且在计数器DD0、DD2的输入R3处出现电平1(图3,g)并且在时间t.复位之后,计数器被设置为零。 因此,在切换时间 t 之后h.DD4 级别 4 再次出现在解码器 DD1 的输出处(图 3,e)并且钥匙打开。
键阻塞脉冲的持续时间由总延迟时间t决定h.DD1.3+t重置+th.DD4 在所描述的情况下约为 60 ns。 这足以从序列中排除持续时间约为 50 ns 的脉冲。 表中总结了从重复率 f=10143,57 kHz 的石英振荡器脉冲获得的输出信号的频率值,用于将解码器输入连接到计数器输出的四种选项(对应于 n=67、68、70、71),其中 df 是解码器输出处阻塞脉冲的重复率(使用频率计数器 Ch3-33 进行测量)。 正如您所看到的,在 n = 10000 时获得最接近所需频率 (71 kHz) 的频率值(通过选择电容器 C1 可以进一步降低频率)。
由于石英振荡器脉冲的持续时间比阻塞脉冲的持续时间长,被排除的脉冲将部分地传递到设备的输出并扰乱获得所需频率的信号的过程。 消除这个缺点的最简单方法是增加来自发生器的脉冲的占空比。 占空比转换器可以根据图4所示的方案进行。 4 并在[XNUMX]中描述。
其工作时序图如图所示。 5. 该装置连接在变频器的元件DD1.1 和DD1.2 之间。 在这种情况下,元件DD1.2输出处的脉冲的持续时间将等于元件DD5.1-DD5.3在晶体振荡器的任何频率下的总延迟时间(45...55ns)。
所描述的变频器具有广泛的附加特征。 使用完整的计数器和解码器,可以阻塞每2-256个脉冲,即将分频比从2更改为1 + 1/256,并且通过改变计数器电容并串联多个转换器,以最低的成本获得准确的值和较低的频率。 该器件可用作将输入频率分成两个分量的“分离器”:f0 和 df。 在这种情况下,从解码器输出获取的脉冲将具有恒定的重复周期,并且晶体振荡器信号的分频因子将等于f/df。 通过在计数器的输出和解码器的输入之间设置逻辑键,可以直接用二进制代码信号控制设备的分频系数,并将其用于代码频率转换器、频率调制器等。 通过实施加法运算 f,该转换器还可以成功用于分数倍频(非整数倍)0=f+df。 为此,需要将每个编号为 n=f/df 的脉冲“切割”为两部分,从而向原始序列添加额外的脉冲。 获得所需的操作模式非常简单:将 R2C2 延迟电路转移到将来自 DD4 解码器输出的脉冲馈送到 DD12 元件的引脚 1.4 的电路即可。 在这种情况下,阻塞脉冲必须比发生器脉冲至少短 70 ... 100 ns(对于 K155 系列微电路)。 对于短持续时间的发生器脉冲,包含占空比转换器而不是 DD1.2 元件(图 4)。 在这种情况下,器件操作的时序图如图 6 所示。 XNUMX.
在乘法模式下,使用石英谐振器对转换器进行测试,频率为 f = 1014,36 kHz:当 n = 68 时,频率 f0=1029,277 kHz。 应该记住,为了转换器的可靠运行,可能需要选择 10...30 ns 范围内的延迟时间 t。 文学
作者:A.Samoilenko,新罗西斯克 查看其他文章 部分 业余无线电设计师. 读和写 有帮助 对这篇文章的评论. 科技、新电子最新动态: 控制和操纵光信号的新方法
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